以下内容摘自:
VPB 分频器决定处理器时钟(cclk)和外设时钟(pclk)之间的关系。VPB 分频器有两个用途。第一 通过
VPB总线为外设提供需要的PCLK时钟,以便外设能在选择的ARM处理器速度下操作。为了实现该特性,
VPB 总线频率可以降低为处理器时钟频率的 1/2 或 1/4。由于上电后 VPB 总线必须正常工作(如果它由于
VPB 总线的 VPB 分频器控制寄存器的原因而不能工作,则 VPB 总线的时序不能改变),因此,VPB 总线
在复位后的默认状态是以 1/4 速率运行。VPB 分频器的第二个用途是当所有外设都不必在全速率下运行时
降频以降低功耗。由于VPB分频器连接到PLL的输出,PLL(如果正在运行)在空闲模式时保持有效。
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