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qian-xu-feng

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关于verilog 在quartues内不可综合的语句

分类： LINUX

2012-09-06 13:26:15

在位运算中，如果是按位取反符号～，在一个多位寄存器前做运算，这个多位寄存器就可综合。例子：
reg a[5:0]
if(~a==0)
 b=x;
此事a就是不可综合的.根据verilog语法应该是可以综合的
 
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