系统时钟和定时器简单记录_wangh0802-ChinaUnix博客

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系统时钟和定时器简单记录

发布时间：2012-12-18 20:18:54

S3C2440A 中的时钟控制逻辑可以产生必须的时钟信号，包括CPU的FCLK，AHB总线外设的HCLK以及APB总线外设的PCLK。S3C2440A 包含两个锁相环（PLL）：一个提供给 FCLK、HCLK 和PCLK，另一个专用于USB模块（48MHz）。时钟控制逻辑可以不使用PLL来减慢时钟，并且可以由软件连接或断开各外设模块的时钟，以降低功耗。锁相环（PLL）：时钟发生器之中作为一个电路的MPLL，参考输入信号的频率和相位同步出一个输出信号。用于生成与输入直流电压成比例的输出频率的压控振荡器（VC......【阅读全文】

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给主人留下些什么吧！~~

aifinsrc2012-10-29 13:50

您好, 剛剛看了您的文章「NAND FLASH实验读ID和随机读写」, 相當精彩可及! 蛋裡面似乎有些function沒有加入, 例如 NF_Enable_RB( ), NF_Send_Cmd...等等, 是否方便您分享source code呢? 若可, 煩請寄到chechia.li@msa.hinet.net / aifinsrc@hotmail.com

若不介意, 是否可以加入我QQ呢: 小拿鐵 aifinsrc@hotmail.com /2494408163

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