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发布时间:2012-05-25 23:06:26

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发布时间:2015-02-26 15:30:07

MTRR (memory type range register) 是关于物理内存在CPU能否缓存的描述, 有Fix MTRR, Variable MTRR, Defult MTRR,  固定MTRR是指前1M的物理内存已经有特定的寄存器来描述了,每段物理内存的大小已经确定下来了,编程时只需要指定每段物理内存的memory type就行了,如UC(Uncacheable), WB(Write Back), WC(Write C.........【阅读全文】

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发布时间:2014-10-31 17:40:31

早就想整理网络数据包收发流程了,一直太懒没动笔。今天下决心写了一、硬件环境intel82546:PHY与MAC集成在一起的PCI网卡芯片,很强大bcm5461:   PHY芯片,与之对应的MAC是TSECTSEC:      Three Speed Ethernet Controller,三速以太网控制器,PowerPc 架构CPU里面的MAC模块&n.........【阅读全文】

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发布时间:2014-10-31 17:40:22

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发布时间:2014-10-31 17:40:11

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给主人留下些什么吧!~~

安何2010-05-27 09:51

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flb_20012010-04-12 08:11

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SanRoute2010-03-25 22:27

dean_go: 你好。

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config20102010-01-15 01:25

FPGA有2个PIN与2440中断相连。1s都可以产生1333次中断(750us)。 中断服务子程序:产生中断后将fpga寄存器的数据读出放入内存(链表的一个元素),并由2440写FPGA寄存器清除中断,通知驱动中的读函数数据已处理完毕(这一块是用等待队列,来唤醒驱动中的读函数)。从示波器上看,完成这些用了50us. 我想让每次中断产生的数据在下次中断来前执行完毕,也就是说还有700us的时间处理。但是现在两个中断同时出现不能完成,一个中断可以完成。若将中断周期换为1ms,刚两个可以同时完成。(完成思路:读取链到的一个元素(128位)到用户层,在链表中删除这个元素,再由socket送入PC)。任意时刻链表的长度为1或者0。 出现问题的现象:链表的长度瞬时变的很长,上万。我猜就是下次中断来之前数据没读走,就造成了恶性循环,再也读不完。或者两个中断突然就剩下一个,还有个没有了(1,我估计是执行的过程中,没有清楚中断就退出,恢复不了了,可能是没有保护好,不知???) 2,从时间是看,剩下的700us怎么可能处理不完这件事情呢? 3,同时处理两个难道cpu到极限的吗? 4,cpu中断返回后,是不是没有立即去等到队列等待处去执行,过了会才过去?有没有对策。 5,我估计cpu每次从中断返回到驱动中的读函数数据这个切换过程可能耗时很多(猜),所以我尝试的方法:10次中断的数据存在一起后,再唤醒驱动中的读函数的等待队列去读。结果是一样的,还是来不及?很想不通。 6, 有没有延时中断子函数的方法?local_irq_save()?

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