分类： 嵌入式
2010-10-27 12:32:31
其实无论用简单的protel或者复杂的cadence工具，硬件设计大环节是一样的 （protel上的操作类似windwos，是post-command型的；而cadence的产品concept & allegro 是pre-command型的，用惯了protel，突然转向cadence的工具，会不习惯就是这个原因）。设计大环节都要有1）原理图设计。 2）pcb设计。3）制作BOM表。现在简要谈一下设计流程（步骤）：
1）原理图库建立。要将一个新元件摆放在原理图上，我们必须得建立改元件的库。库中主要定义了该新元件的管脚定义及其属性，并且以具体的图形形式来 代表（我们常常看到的是一个矩形（代表其IC BODY），周围许多短线（代表IC管脚））。protel创建库及其简单，而且因为用的人多，许多元件都能找到现成的库，这一点对使用者极为方便。应搞 清楚ic body，ic pins，input pin，output pin， analog pin， digital pin， power pin等区别。
2）有了充足的库之后，就可以在原理图上画图了，按照datasheet和系统设计的要求，通过wire把相关元件连接起来。在相关的地方添加 line和text注释。wire和line的区别在于，前者有电气属性，后者没有。wire适用于连接相同网络，line适用于注释图形。这个时候，应 搞清一些基本概念，如：wire，line，bus，part，footprint，等等。
3）做完这一步，我们就可以生成netlist了，这个netlist是原理图与pcb之间的桥梁。原理图是我们能认知的形式，电脑要将其转化为pcb，就必须将原理图转化它认识的形式netlist，然后再处理、转化为pcb。
4）得到netlist，马上画pcb？别急，先做ERC先。ERC是电气规则检查的缩写。它能对一些原理图基本的设计错误进行排查，如多个 output接在一起等问题。（但是一定要仔细检查自己的原理图，不能过分依赖工具，毕竟工具并不能明白你的系统，它只是纯粹地根据一些基本规则排查。）
5）从netlist得到了pcb，一堆密密麻麻的元件，和数不清的飞线是不是让你吓了一跳？呵呵，别急还得慢慢来。
6）确定板框大小。在keepout区（或mechanic区）画个板框，这将限制了你布线的区域。需要根据需求好考虑板长，板宽（有时，还得考虑 板厚）。当然了，叠层也得考虑好。（叠层的意思就是，板层有几层，怎么应用，比如板总共4层，顶层走信号，中间第一层铺电源，中间第二层铺地，底层走信 号）。
7）to be continued......
