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2009-11-12 10:53:18
网表/电路图反向提取
在中,网表/电路图的提取是个很大的课题,网表提取的质量和速度直接影响后续整理、仿真、LVS等方方面面的工作。我们在总结众多成功案例的基础上,依托自主研发的软件应用,可准确、快速、高质量地进行网表/电路图的提取。
逻辑功能分析
网表提取结束后,往往需要进行电路的整理工作,把一个打平(flatten)的电路进行层次化(hiberarchy)整理,形成一个电路的层次化结构,以便理解设计者的设计思路和技巧,同时还能达到查找网表错误的目的。
版图设计是电路逻辑的物理实现,是集成电路产品实现(ChipLogic Layeditor)。我们在反向设计的基础上提供版图的提取、工艺库替换、目标工艺修改、DRC检查和LVS校验等各种设计服务。
逻辑版图验证
网表和版图设计结束后,往往需要对其正确性进行各种验证,为了保证设计流程的完整性,盛世提供芯片网表数据和版图数据的各种验证服务。
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