IP核下载列表 (最新全集)
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2. IP原作者版权所有,严禁商用。切记!
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+ \- L" l, l# F6 e8 Y【闪存=发行包=已验证】NAND闪存接口实现
2 `* H2 s$ N; p( D【内存=发行包=已验证】Micron 全系列DDR模型与testbench (SDRAM DDR/~2/~3)
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【内存=发行包=未验证】内存控制器设计原理与工程包
2 ]0 _% K, }1 R1 G【内存=发行包=未验证】SDRAM控制器(Verilog,含设计心得)
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( I$ s2 W6 [( _【信号=仅代码=已验证】曼彻斯特编解码(
verilog)
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【信号=近代码=未验证】3阶分布式FIR滤波器
+ @" @' M; a" k5 P' i, h2 k# s【信号=近代码=未验证】6阶分布式FIR滤波器
. c' J# G# \ q& P @【信号=发行包=已验证】
Reed Solomon 解码模块
2 x7 w8 i0 d0 }* O( g【信号=发行包=已验证】二进制与BCD互相转换
模块0 m7 d. j% P+ l4 p2 x2 g
{( z8 d3 B" o1 N3 v. H% n【图像=仅代码=未验证】RGB转YCbCr
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* f/ |/ L8 D, ?【通信=发行包=已验证】802.3以太网(Ethernet) MAC
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【安全=发行包=未验证】SHA-1
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M8 N, n3 u C( n4 g6 j" k【总线=发行包=未验证】WishBone To HPI 总线转换(Verilog/VHDL)
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( ?% ?2 ?, @# T( ]【接口=发行包=
仿真通过】USB1.1
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【接口=发行包=已验证】SPI 开源IP
0 Z5 ~4 L3 K3 i* I7 j; g【接口=发行包=已验证】I2C接口(Verilog/VHDL双版本)
* d6 Q' [9 A5 B5 _0 t7 t- Y# m【接口=发行包=已验证】UART 16550
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【RISC=发行包=未验证】适合入门的最简单CPU
8 |! U% V, Q5 w( }' ?" Z- T0 `* H
【RISC=发行包=已验证】ARM7源代码与仿真包——伊力诺依大学
- p6 Y( j; a$ v9 M【RISC=发行包=未验证】LEON2 发行包
, }; X3 Q( \ w【RISC=仅代码=未验证】ARM7两个软核(VHDL和Verilog双版本)
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【RISC=书籍附件】《开源软核处理器Openrisc的SOPC设计》的附件
0 `5 x# v) n) R2 r: b9 F【RISC=发行包=未验证】Tiny OR1200 (Verilog)
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7 |" i$ F- c: ]【CISC=发行包=已验证】MiniCPUCore及其编译器(Lattice ECP2验证通过)
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【SoC=发行包=已验证】使用wishbone总线的最小系统mcpu
# ^8 d9 N. R6 L0 \0 V【SoC=发行包=已验证】Mini OR1200含UART消息(Verilog)
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【SoC=发行包=已验证】Openrisc + Wishbone + UART + Int-Mem仿真验证
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' d- Y/ M. F5 {: x' Y7 |0 O, x6 A【单片机=发行包=核加密】DP8051-Free(内核不可见)
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【单片机=发行包=未验证】DW8051(Verilog源代码+文档介绍)
/ l, }' n) s* [; ]$ d【单片机=发行包=未验证】C8051可
综合VHDL内核 (From Evatronix)
+ {# H8 W& ?4 v* v+ Q- C【单片机=发行包=已验证】MC8051 IP (VHDL)
" @( ?" K+ R4 ]0 s b% U m【单片机=仅代码=未验证】Q8051(带jtag)
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【工具】开源C:将HEX转换为XILINX的COE内存初始化文件
a t! v/ ^, U9 q2 v& Q; w9 [【工具】cordic_v1.0.4 Altera IP
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1. 绝大部分IP来自网络,缺乏足够的测试,仅供大家学习之用。
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3. 获取IP刀的唯一方法是:在本版块(常用IP核)中上传有效的IP核代码或者发行包。: [! k6 |" {" n6 y: N
4. 每个完整的IP核可以获得5个IP刀,上传后即刻生效。
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